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In-Depth Information
Lorsque l'opérande est une valeur immédiate, le mode d'adressage associé à l'opérande
est le mode d'adressage immédiat . L'information complémentaire est l'opérande lui-
même (figure 4.8).
Lorsque l'opérande est contenu dans un registre, alors le mode d'adressage associé
est un mode d'adressage registre ou implicite. L'information complémentaire est le
numéro du registre qui contient l'opérande.
Lorsque l'opérande est un mot mémoire, l'un des modes d'adressage associés peut-
être le mode d'adressage direct . Dans ce cas, l'information complémentaire désigne
l'adresse du mot mémoire contenant l'opérande concerné par l'opération. Un autre
mode d'adressage associé peut être le mode d'adressage indirect . Dans ce cas, l'infor-
mation complémentaire désigne également l'adresse d'un mot mémoire, mais ce mot
mémoire contient lui-même une adresse qui est l'adresse du mot mémoire contenant
l'opérande concerné par l'opération.
4.2.3 Un exemple
Imaginons une machine qui admet des instructions sur 32 bits de type registre/mémoire.
Le format d'une instruction est donné par la figure 4.9.
COP
m
reg1
reg2
champ2
0
5
8
12
16
31
Figure 4.9
Format d'une instruction machine.
Ce format comprend :
- COP est le Code OPération codé sur 5 bits ;
- m est le mode d'adressage codé sur 3 bits;
- reg1 et reg2 codent un numéro de registre sur 4 bits (de 0000 2 à 1111 2 );
- champ2 est une valeur immédiate, une adresse mémoire ou un déplacement codé
sur 16 bits.
reg1, reg2 et champ2 codent l'information complémentaire du mode d'adressage m
permettant de trouver les opérandes de l'opération.
L'instruction admet soit :
- un seul opérande qui est alors un registre du processeur codé dans le champ reg1;
- deux opérandes, qui sont soit deux registres du processeur codés dans reg1 et
reg2, soit un registre codé dans reg1 et une valeur immédiate codée dans champ2,
soit un registre codé dans reg1 et un mot mémoire codé via le mode d'adressage
m et la valeur précisée dans champ2.
Les codes opérations
Le code opération est une chaîne de 5 bits ce qui permet de coder 32 opérations
différentes. Le tableau 4.4 donne quelques codes opérations :
 
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